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Observe o flip-flop da figura abaixo e analise as proposições que se apresentam abaixo.

1) Trata-se de um flip-flop RS Síncrono.

2) Pulso de relógio (clock) determina o instante de atualização das saídas Q e Q^-.

3) A entrada CK (clock) inibe as entradas R e S quando seu nível lógico é 0

4) Não existe problema de erro lógico quando R=S=1

Estão corretas: